 Imre Deak
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4a76f295bc
drm/i915/skl: don't toggle PW1 and MISC power wells on-demand
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10 년 전 |
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Imre Deak
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73dfc227ff
drm/i915/skl: init/uninit display core as part of the HW power domain state
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9 년 전 |
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Imre Deak
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30eade12d6
drm/i915: rename intel_power_domains_resume to *_sync_hw
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10 년 전 |
 Damien Lespiau
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2f693e28b8
drm/i915: Make turning on/off PW1 and Misc I/O part of the init/fini sequences
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10 년 전 |
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Imre Deak
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fc17f2274e
drm/i915: fix lookup_power_well for power wells without any domain
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10 년 전 |
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Imre Deak
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56fcfd6333
drm/i915: fix the power well ID for always on wells
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10 년 전 |
 Animesh Manna
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ca1283d502
drm/i915/skl: Removed assert for csr-fw-loading check during disabling dc6
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10 년 전 |
 Daniel Vetter
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414b7999b8
drm/i915/gen9: Remove csr.state, csr_lock and related code.
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9 년 전 |
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Daniel Vetter
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af5fead2d9
drm/i915/gen9: move assert_csr_loaded into intel_rpm.c
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10 년 전 |
 Ville Syrjälä
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18a04a7369
drm/i915: Kill intel_runtime_pm_disable()
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10 년 전 |
 Rodrigo Vivi
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ef11bdb3e0
drm/i915/kbl: Introduce Kabylake platform defition.
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10 년 전 |
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Animesh Manna
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0a9d2bed55
drm/i915/skl: Making DC6 entry is the last call in suspend flow.
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10 년 전 |
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Ville Syrjälä
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3be60de9e9
drm/i915: Skip CHV PHY asserts until PHY has been fully reset
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10 년 전 |
 Jesse Barnes
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165ed87c47
drm/i915: fixup runtime PM handling v2
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10 년 전 |
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Animesh Manna
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08aef7caa1
drm/i915/skl: Block disable call for pw1 if dmc firmware is present.
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10 년 전 |
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Jesse Barnes
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6ff8ab0d0f
drm/i915: make CSR firmware messages less verbose
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10 년 전 |
 Daniel Vetter
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e93c28f393
Merge tag 'drm-intel-next-fixes-2015-09-02' into drm-intel-next-queued
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10 년 전 |
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Ville Syrjälä
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30142273a3
drm/i915: Add CHV PHY LDO power sanity checks
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10 년 전 |
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Ville Syrjälä
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6669e39f95
drm/i915: Add some CHV DPIO lane power state asserts
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10 년 전 |
 Xiong Zhang
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d8e19f99d3
drm/i915/skl: Adding DDI_E power well domain
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10 년 전 |
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Ville Syrjälä
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3e28878635
drm/i915: Force CL2 off in CHV x1 PHY
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10 년 전 |
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Ville Syrjälä
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ee27921824
drm/i915: Enable DPIO SUS clock gating on CHV
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10 년 전 |
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Ville Syrjälä
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b0b3384612
drm/i915: Trick CL2 into life on CHV when using pipe B with port B
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10 년 전 |
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Ville Syrjälä
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e0fce78f04
drm/i915: Implement PHY lane power gating for CHV
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10 년 전 |
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Ville Syrjälä
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5a8fbb7d19
drm/i915: Move DPLL ref/cri/VGA mode frobbing to the disp2d well enable
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10 년 전 |
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Ville Syrjälä
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770effb19f
drm/i915: Add locking around chv_phy_control_init()
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10 년 전 |
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Damien Lespiau
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dcddab3aa0
drm/i915: Extract a intel_power_well_disable() function
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10 년 전 |
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Damien Lespiau
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e8ca932056
drm/i915: Extract a intel_power_well_enable() function
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10 년 전 |
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Ville Syrjälä
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2be7d540fd
drm/i915: Refactor VLV display power well init/deinit
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10 년 전 |
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Ville Syrjälä
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8fcd5cd8b3
drm/i915: Simplify CHV pipe A power well code
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10 년 전 |
